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一文讲透上下拉电阻能否增强驱动能力最近看到一个关于上下拉电里的问题，发现不少人认为上下拉电阻能够增强驱动能力。随后跟几个朋友讨论了一下，大家一致认为不存在上下拉电阻增强驱动能力这回事，因为除了OC输出这类特殊结构外，上卜拉电阻就是负载，只会减弱驱动力。但很多经验肯定不是空穴来风,秉承工程师的钻研精神,我就试着找找这种说法的来源，问题本身很简单，思考的过程比较有趣'二极管逻辑今天已经很难看到二极管逻辑电路了，其实用性也不修高，不过因为电路简单，非常适合用来理解基本概念。个最简单的二极管与门如下图所示。与门实现逻辑与操作Y=AftB,即A或者B任意为1.的时候，输出Y为1.,只有当A和B都为H时,丫才为H.战本二极管与门假设二极管无导通压降，在这个电路中，二极管充当J'单向开关的角色，当A和B等于YDD时，两根二极管反向截至，Y被电阻上拉到VDD,这是丫就是II：当A或者B任意一端为GND时，二极管导通，因为二极管导通时电阻很小，远小于上拉电阻，所以丫被拉到了GND,即逻辑1.。至于二极管或门，只要把二极管转一下，再把电阻从拉到YDD改成拉到GM）就可以/,非常简单.基本二极管或门基本原理你看，在这么原始的逻辑电路中就已经出现了上下拉电阻，这里面的原理也非常简单粗暴：利用开关的闭合(电阻为()和开启(电阻无穷大)的特性，配合电阻，就可以轻松实现两种电压的输出。这种电路还有一个变形，就是用恒流源取代电阻，一方面生成电路工艺,恒流源比电阻更容易获得，另一方面恒流源的驱动能力也更好。根据开关和电限(或恒流源)的相对位置，有以下基本电路：即开关接到GND(1.)或开关接到VDD（三）«几种开关电路接法这儿种电路都是由开关的闭合或开启决定了VOUT是YDD还是GND。开关的相对位置不同，还决定了电路在某一状态下的驱动能力：开关的导通电阻为0,可视为驱动力无穷大，可是电阻（或恒流源）的驱动能力呢，只有VDD/R（或者恒流I）,这就导致了电路在输出I1或1.的时候招动能力不对称（换一个说法，就是电路在输出H或者1.的时候，输出阳抗不样）。除了驱动能力的问题，这种单开美加电阻的模武还会带来静态功耗的问题，因为只要开关闭合，不管外部有没有负载，都公消耗电流.既然开关的驱动力比电阻强，那么能不能把电阻也换成开关？恭喜你，发现了现代CMOS逻辑电路的基本单元：俩互补的开关。这样不管输出H还是输出1.,驱动能力都是无穷大！好的，这时候上下拉电阻就不见了。这样两个开关的电路还多出来了种状态：当两个开关都开启时，VoUT即不是VDD也不是GMh而是一个悬空的状态（即高阻态，Hi-Z）,这时候外部给什么信号它就是什么状态。这样又出现了一个新的逻辑门大类:三态逻辑门。互补开关电路上下拉电阻增强驱动能力？很多经验不是空穴来风,只是在流传的过程中丢失了重要的前提条件。上一节也看到r有一些逻辑器件，他们输出高和输出低时的驱动能力差别很大。Tr1.(70xx.741.xx,74Sxx.741.SXX等)家族的器件就属于这种类型,如下图是7404Cn1.反相器)的原理图，由于非对称的输出级设计,输出为高时驱动能力只有04，而输出低时居然能输出16mA的电流(手册中的输出电流不是品体管或界电路本身的极限,而是超过这个电流以后，输出的电压可能无法满足逻辑族的耍求。7404的简化电路这个时候在输出附旦外加一个上拉电阻,就可等效以增强端门在输出I1.时的驱动能力，但代价是端口输出1.时，驱动能力相应地减弱，不过这时候辿输出能力足够强，用这点代价来换取另一个状态动能力的增强，还是划算。带上拉电阻的7404下表是坦直有无上拉电阻时，负栽电流与输出电压的关系，可以看到上拉电阻确实增强了在一定负我下的输出电压，不过当负我电流较大时效果并不明显，而且边际效应也很显著，当上拉电阻减小到一定程度以后，增强效果也不太显著，而I1.会大大增加静态功耗。带不同上拉电阻的7104输出电压与负载电流的关系既然非对称的输出级有这样的问题，那为啥不能把这个驱动器设计成上下对称的呢?一方面，如果要设计成上下时称的结构，上管需要用P管，而当时的工艺限制，P管各方面性能都不如N管，速度、功耗和成本都不是很划算，所以能看到很多上年代的芯片，内部几乎没有P管（包括MOS工艺的器件也是。另方面TT1.输入结构的特点，输入为H时所需电流很小，而输入为1.所需的输入电流很大，这样对输出1.时的驱动能力要求就很而，反而对输出H时没有驱动能力要求（TT1.输入悬空时等效为ID。但TT1.的这种特点，又会带来一个比较麻烦的问题：卜拉电阻值需要很大才能满足要求，而卜拉电阻太大则会导致输出高时负载太重以至于无法达到规定电床，所以TT1.要尽量避免使用下拉。下图是仿真结果，因为这是一个反相器，所以下拉时输出离是所期望的，而下拉电阻超过I.8kQ时已经无法满足TT1.定义的最低电平标准了；而上拉时，就算上拉电阻达到20k,也丝皂不影响输出。TT1.上卜拉电阻取值与输出电压的关系CMoS电路相信现在已经没多少人会在设计时选用TT1.家族的器件了，可能多数人都没接触过这类涔件，圾常用的还是CMOS家族（H、HCT、1.VC.CD4000等）。G1.OS家族的东西就比较简堆粗暴，上卜对称的结构，上卜管胆动能力也基本一致，这个时候输出的上下拉电阻对增强驱动能力几乎没有帮助不说，还加重了负载，属F得不偿失（其实多数情况下是无关痛痒）。下图是基本的CMOS反相济，只需要一对互补的MOS管即可实现（现实中的CMOS反相器一般是三对这种管子级联出来的，为了提高开环增益）。但是CMOS器件的辘入悬空时，不会被拉向任何个方向，处于一种浮空的状态，这样会造成输出紊乱，不是我们所希望的结果，这种情况下需要在输入端接入上拉或者下拉电阻给电路提供一个确定的状态。一般可拔插的对外接U（如JTAG）需要在1/0上加上上卜.拉电阴，有三态的总线视工作情况也可能需要上卜拉，不过大多数的CMoS电路不需要额外的上卜.拉电阻。CMOS罂件在使用是般要加上下来避免输入悬空因为CMoS输入是电压控制型，输入阻抗很高，所以上下拉电阻的值可以很大，理论上用MQ级别的电阻都没问题。不过理论归理论，工程师得认清现实。现实的CMOS输入结构，为了保护MoS管的栩极，会在栅极上加入时二极管，二极管反向偏置的时候是有漏电流的，还会随温度的升高还会指数增长！所以CMoS电路的上下拉电阻一般在K)OkQ以下，些制程比较先进的里，I/O口的漏电流或者上下拉电流较大，上下拉电阻一般取在几kQ级别.所以设计上下拉电阻前一定要仔细阅读芯片手册，查隹I/O的输入电潦，看看取什么样的电阻值才合理。CMOS输入有ESD二极管其他需要上下拉的情况开集(OPen-COIIeCIOr)和开漏(OPen-DrUin)的输出结构往往也需要加上拉电阻。OC和OD输出结构只有卜.管，所以只能输出1.和高阻(Hi-Z)两种状态，而高阳态是琲以被电路识别的,所以需要合适的上拉电阳把鬲町态转变为向态。OC（左）和OD（右）输出结构虽然OC和OD输出结构看起来很第占，使用时也需要外接阻阻有点麻烦，但这种结构最大的好处就是可以做线与，也就是多个OC或者OD可以接到一起，只要其中一个输出【“总线就是1.,这在多外设中断和生源时序控制方面很常用。OC/OD的线与接法竺也是OC/OD结构，这样很轻松就能在条数据线上双向传输数据而不需要额外的方向控制信号，而空总线则巧妙地利用线与特性来实现总线仲裁。在处理OC或者OD电路的时候，一定理注意评估总线负载电容、上拉电阻与所需速度的关系，负载电容越大，速度越快，所需的上拉电阻要越小。比如12C总线，如果只挂载了一片从设备,使用4.75kQ的上拉电阻可能就满足40OkHZ的总线要求了，但如果挂了10片从电备呢，IkQ的上拉电阻也不定能搞定100kHz的总线速度，这种时候可能得考虑总线负载隔离或者降低总线速度/0下图是在200PF负栽电容情况下,上拉电阻为500a、Ika、2k。、4.75ka和IOk卜的波形，可以看到上拉电阻越大，对电容充电速度越慢，所以上升沿也越慢，当上拉电阻不合适时上升沿已经严重变形，无法保证正常工作。OC电路不同上拉电阻对波形的膨响冷知识逻辑反相器可以当成放大器来用!不是开玩笑，我还点见过产品上用这种骚操作的，只需要把反相器接成反向放大器就可以了，不过逻辑器件当线性器件用，性能嘛.逻辑反相罂（非门）当成线性放大器用