单片机第五章单片机中断系统.ppt
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1、单片机系统中,CPU和外部设备之间不断进行信息的传输。通常CPU和外设之间的信息传送方式有以下几种:程序控制方式中断方式直接存储器存取(DMA)方式,第5章 MCS-51单片机中断系统,5.1.1中断的概念,1、程序控制方式 可以分为以下两种方式。(1)无条件传送方式 外设始终处于就绪状态,CPU不必查询外设的状态,直接进行信息传输,称为无条件传送方式。此种信息传送方式只适用于简单的外设。如开 关和数码段显示器等。,(2)条件传送方式 CPU通过执行程序不断读取并测试外部设备状态,如果输入设备处于准备好状态或输出设备为空闲状态时,则CPU执行传送信息操作。由于条件传送方式需要CPU不断地查询外
2、部设备的状态,然后才进行信息传送,所以也称为“查询式传送”。,2、中断方式 外部设备与CPU之间以中断信号作为数据交换的控制信号。当外部设备需要与CPU进行数据交换时,由接口部件向CPU发出一个请求信号,CPU响应这一中断请求后,在中断服务程序中完成一个字节或多个字节的信息交换。中断方式具有并行工作、实时传输、充分利用CPU效率等特点。,3、DMA方式(直接存储器存取)DMA控制方式主要用于存储器和外设之间直接传送、块传输。DMA请求总线:当某一外部设备需要输入/输出一批数据时,向DMA控制器发出请求,DMA控制器接收到这一请求后,向CPU发出总线请求信号。,DMA控制数据传输:CPU响应DM
3、A的请求,把总线使用权交给DMA控制器,DMA将外设数据读入、并直接写入存储器,或将数据从存储器读出并直接送给外设。传送过程不需要CPU参与。DMA释放总线:当一批数据传送后,DMA控制器再向CPU发出“结束总线请求”,CPU响应请求,收回总线使用权。DMA方式速度高、效率高,可以与CPU并行工作。,CPU执行程序时,由于发生了某种随机的事件(外部或内部),引起CPU暂时中断正在运行的程序,转去执行一段特殊的服务程序(称为中断服务程序或中断处理程序),以处理该事件,该事件处理完后又返回被中断的程序继续执行,这一过程称为中断。,中断的定义,2、中断源 引起CPU中断的设备和事件就是中断源。3、中
4、断请求 中断源向CPU发出的请求处理信号,即中断请求或中断申请。4、中断响应 CPU暂时中止正在处理的事情,转去处理突发事件的过程,称为中断响应。,5、其他概念 中断系统:实现中断功能的部件称为,又称中断机构。中断服务程序:CPU响应中断后,处理中断事件的程序。断点:CPU响应中断请求,转去执行中断服务程序时的PC值,即为断点地址。中断返回:CPU执行完中断服务程序后回到断点的过程。,中断系统功能,中断系统是指能够实现中断功能的那部分硬件电路和软件部分。,实现中断请求实现排队判优(中断优先级排队)实现中断响应实现中断服务程序的转接实现中断返回实现多重中断,中断源类型,引起CPU中断的事件,发出
5、中断请求的来源。,1、外部设备中断源2、控制对象中断源3、故障中断源4、定时脉冲中断源,中断分类,中断按照功能通常可以分成:可屏蔽、非屏蔽和软件中断三类,1、可屏蔽中断 程控“开中断/关中断”。软件设置允许/禁止CPU响应中断。,2、非屏蔽中断 指CPU对来自/NMI中断输入线上的中断请求是不可屏蔽(或控制)的。,3软件中断 指人们可以通过相应的中断指令使CPU响应中断。CPU只要执行这种指令就可以转入相应的中断服务程序执行,以完成相应的中断功能。,中断分类,中断嵌套,低级中断请求,RETI,主程序,响应低级中断,高级中断服务子程序,返主程序,继续执行主程序,高级中断请求,响应高级中断,返低级
6、中断,RETI,低级中断服务子程序,低级中断服务子程序,挂起低级中断,挂起低级中断,低级中断,低级中断,5.1.2 中断系统的结构,专门讨论MCS-51的中断源和中断标志、MCS-51对中队请求的控制和响应、中断响应时间、中分段撤除和中断系统初始化。,源允许,中断系统总体逻辑结构,总允许,优先级,中断标志,中断标志,1,IE0,矢量地址送PC,“+1”,TF1,0,矢量地址送PC,EA,“+1”,“+1”,EX0,ET1,1,中断源与中断请求标志,5个中断源2个优先级,2个外部中断,3个内部中断,T0,T1,UART,与中断有关的特殊功能寄存器:,IP:中断优先控制寄存器,IE:中断允许控制寄
7、存器,TCON:定时/计数控制寄存器,SCON:UART控制寄存器,中断标志寄存器,可编程,可控,MCS 51中断要点,MCS 51中断要点,定时/计数器控制寄存器TCON,TCON(88H),触发方式控制位,0 低电平触发,1 边沿触发,外部中断请求标志,1 有有效触发时,0 当CPU响应中断时,T1 T0,溢出标志,1 计数器“+1”有溢出时,并向CPU请求中断,0 当CPU响应中断时,也可由指令清除,TR1 TR0,由硬件自动,由硬件自动,TR1 TR0,由硬件自动,由硬件自动,在每个机器周期 S5P2都采样引脚 P3.3 P3.2,引脚,0,0,记录有无中断,记录有无中断,串行口控制寄
8、存器 SCON,TI:串行口发送中断标志,在方式0,串行发送到第8位结束时,由硬件置“1”;或在其他方式中,串行发送到停止位的开始时,由硬件置“1”,,RI:串行口接收中断标志,在方式0,串行接收到第8位结束时,由硬件置“1”;或在其他方式中,串行接收到停止位的开始时,由硬件置“1”,,“1”发送完一帧数据后,“1”接收完一帧数据后,必须由软件清“0”必须由软件清“0”,SCON(98H),5.2 MCS-51的中断控制,1、中断允许寄存器 IE,0 禁止,1 允许,0 禁止,1 允许,总 中断,总 中断,中断,中断,IE(A8),中断的开放和禁止是可控,可编程的,ET2,CPU,IE 的相应
9、位被置“0”或“1”该相应中断即被“禁止”或“开放”,例1 假设允许INT0、INT1、T0、T1中断,试设置IE的值。解:(1)用C语言字节操作:IE=0 x8f;(2)用C语言位操作指令 EX0=1;/允许外部中断0中断 ET0=1;/允许定时/计数器0中断 EX1=1;/允许外部中断1中断 ET1=1;/允许定时/计数器1中断 EA=1/开总中断控制 汇编语言(1)用字节操作指令:MOV IE,#8FH(2)用位操作指令:SETB EX0;允许外部中断0中断 SETB ET0;允许定时/计数器0中断 SETB EX1;允许外部中断1中断 SETB ET1;允许定时/计数器1中断 SETB
10、 EA;开总中断控制位,2、中断优先级寄存器 IP,IP(B8),ET2,0 低级,1 高级,中断,中断,中断优先级是可控,可编程的,3、优先级结构,中断优先级控制遵循的两个基本原则:,一个正在执行的低级中断服务程序,能被高优先级 中断请求所中断,但不能被同优先级中断请求所中断。,一个正在执行的高级中断服务程序,不能被任何中断 请求所中断,直到返回。,实现这两个原则的方法:,中断系统内部设置了两个不可寻址的优先级状态触发器。一个指出正在处理的是:高优先级中断,并阻止所有其他中断;另一个指出正在处理的是:低优先级中断,并阻止了除高优先级中断外的其他任何中断。,是不可寻址的,当CPU响应高级中断,
11、并进入中断服务时,“1”,“1”,RETI,“0”,当CPU响应低级中断,并进入中断服务时,“1”,RETI,“0”,在同级的几个中断源中同时发生请求时,内部对同级的各中断源的优先级别有一个规定的查询顺序:,定时/计数器 T0,定时/计数器 T1,串行口 UART,定时/计数器 T2,最高,最低,自然优先级,自然优先级,例2 设定时器和串行口中断为高优先级,两个外部中断为低优先级,试设置IP的值。解:C语言程序IP=0 x3a;汇编语言程序:(1)使用字节操作指令:MOV IP,#3AH(2)使用位操作指令:CLRPX0;设置外部中断0为低级中断,CLRPX1;置外部中断1为低级中断SETBP
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