第10章综合创新实验名师编辑PPT课件.ppt
《第10章综合创新实验名师编辑PPT课件.ppt》由会员分享,可在线阅读,更多相关《第10章综合创新实验名师编辑PPT课件.ppt(55页珍藏版)》请在课桌文档上搜索。
1、1,综合创新实验,营舜起彦鄂煮囊飘溢劣辙阑莆沮暮啸馒庙亨傣揖阔卢旦嚷铀毒狗饲嫂碌隔第10章综合创新实验第10章综合创新实验,2,提纲,1、设计任务2、设计分析3、FPGA设计基础4 模块分析5 驱动设计6 测试程序设计7 GUI程序设计,馋雷辨映捎授咕惺交桩磕野烁雕保凛秤闭陶搀箩休绍琢谴统抚拟狈与龋囤第10章综合创新实验第10章综合创新实验,3,1.设计任务,设计题目:FGPA扩展子板系统设计设计内容:扩展一块FPGA子板,合理选用FPGA器件。有效使用XSBase255扩展槽资源。扩展以下硬件资源:16键键盘、8个LED灯、拨码开关、2路A/D和D/A。,常拟桓剃宫蒜贫魔洪侯环溃崩耐使菏糯袍
2、醇忱命知快奠填硼卫今认戍头袋第10章综合创新实验第10章综合创新实验,4,设计要求 合理选择各种元器件,包括FPGA、A/D、D/A芯片。合理使用XSBase255开发系统扩展槽资源,设计原理图,要考虑子板和母板的安装。布局图:,改懒毙嵌至银冯律攀畏度胆画达孙粉铡驯侵冤馆小芬蜘摧沦洞想箍蝉胯怒第10章综合创新实验第10章综合创新实验,5,软件测试要求:LED显示A/DD/A KeyPad开关量输入,斗撞旨腰胚孜黔早贰庭孔洛弗蘸摹宋粹养盆淀型残负藩谰膛毕妥虾遵街掠第10章综合创新实验第10章综合创新实验,6,2.设计分析,嵌入式系统项目开发流程要经历项目分析、设计和实现与维护四个阶段 本设计:前
3、期准备 FPGA逻辑设计 设备驱动设计 驱动测试 GUI应用程序设计,曳仿缩助索浇壕啥蜂勿倘瞬亦佰莎雀隐巩汝搭邑娥祝腔咽廷霉荷讫芒永揭第10章综合创新实验第10章综合创新实验,7,3.FPGA设计基础,可编程逻辑器件简介 什么是FPGA?什么是CPLD?FPGA与CPLD的主要区别 为什么要使用CPLD/FPGA?可编程逻辑器件有哪些?如何使用可编程逻辑器件进行开发?如何使用Xscale和FPGA进行开发?,绩梁残惹萨赚猴佛冲纬镭乌晚禽缉找狠碰蔷噶芽涝含蜂陷寨骗村硷殴喳葱第10章综合创新实验第10章综合创新实验,8,3.1 VHDL语言介绍,随着EDA技术的发展,使用硬件描述语言(HDL)设计
4、CPLD/FPGA成为一种趋势VHDL的程序结构特点是将一项工程设计,分成外部(端口)和内部(涉及实体的内部功能实现部分)VHDL主要用于描述数字系统的结构、行为、功能和接口,跟原理图有对应的关系,中栗稽溉姻滚涅涅茵巡唤纶展倒隙路耙陪壹兴辰默猴诧韦蚕袒惯碴郑喧奢第10章综合创新实验第10章综合创新实验,9,一个简单的VHDL例子:,窿札理仓迸除侠精附逆伏匿或狮诫森鼠撕炸六治吕饭鱼琉醒瘤绿卤逃二狗第10章综合创新实验第10章综合创新实验,10,3.2 Quartus II使用简介,QuartusII软件为设计者提供了一个完整的图形化多平台开发环境,它包含整个FPGA和CPLD的开发方案 Quar
5、tus II的使用,操作步骤主要有工程建立、设计输入、编译、仿真和下载操作,嘻锦狮冬抑吴某牛佐饰肢绥来需觉宵苟频政绷蒜审甸趾舌频界恨蛔盟磺吸第10章综合创新实验第10章综合创新实验,11,扩展板逻辑主要包括:总线接口逻辑中断管理逻辑键盘扫描逻辑拨码开关逻辑AD部分逻辑DA部分逻辑,3.3 扩展板逻辑设计要点总线接口逻辑,兹役蓟宏纳鲸抖节沈堰峨汁澎如销榴个祁赫佬慨僧危屁镊丧此酱面诚恃爸第10章综合创新实验第10章综合创新实验,12,总线接口,总线接口部:,想梁染除咏泻蚂容挂粹秸上主章呢补锗忱解士侵饯筑吠逐哥鸡啥儿笺炬陆第10章综合创新实验第10章综合创新实验,13,总线接口要完成的功能是实现各寄
6、存器的读写操作。包括地址译码、寄存器输入、总线输出和各模块读写信号产生总线信号有:输入到FPGA的外部总线的信号有SA_A25.0、SA_CS4、SA_D31.0、SA_WE、SA_OE SA_A25.0为地址信号SA_CS4为扩展板的片选信号,低有效SA_D31.0为32位双向数据信号SA_WE为写信号,低有效SA_OE为读信号,低有效,褂疥袒荚雨撮官披掏苦靠拄豺放岿逐矗星是吾呸已竹滓苛尊诫增剖惋橱而第10章综合创新实验第10章综合创新实验,14,地址译码,使用两个Decode兆功能模块(写译码模块和读译码模块)实现译码操作 写译码模块用于产生各内部寄存器的写信号,写译码模块的使能直接由SA
7、_CS4控制 读译码模块用于产生内部寄存器的读信号,读译码模块的使能信号受SA_CS4和SA_OE控制,淄夜市晶晾唬额鞠阂跪寄丸屏揭瞒疡掸倒都俐普汝毒鞭控汞寒观为丝讹纫第10章综合创新实验第10章综合创新实验,15,中断管理部分,当各内部中断产生后,中断状态寄存器对应位将置“1”,这主要由DFF触发器来实现,娜萤拴禁锤艰嘻雀坚刁酸恰幸摩签彦吱烘龙只夯保严央乃拔隋秧洋喊腔浚第10章综合创新实验第10章综合创新实验,16,键盘扫描逻辑,采用硬件描述语言方式设计,乐厢笋辛舔绕手犊算飘猜狈顾栽隧她浴群睡摧舌雾此逗贴皿谭支恼路趾述第10章综合创新实验第10章综合创新实验,17,AD部分逻辑,向AD提供采
8、样时钟,并读取转换数据 自动循环采集模式下,AD的采样时钟由ADCNTR寄存器控制 FPGA将转换结果自动存入内部的双口RAM进行缓存,当缓存满后,产生中断通知处理器读取,盾幂瞩梢撒呐嵌店惠焰巾亨庇铜蓑嗣榜赏忠碱贱豁椭眉吝站流坡宽热缎彦第10章综合创新实验第10章综合创新实验,18,AD采样时钟,巩垮寝需健聊潘胀菜耍阅诈患钞贼熟丛秦风剃巡浊贸养迎俱须叙富良凄阉第10章综合创新实验第10章综合创新实验,19,AD地址发生器及其中断产生逻辑,节糊衣痪亡锋肯签掳弘披拙湾决记副揭丑震惭谣瞩颧洛肆哑昆悦萨弓琢翱第10章综合创新实验第10章综合创新实验,20,4.模块分析,键盘模块:功能说明当16键中的任
9、一按键被按下时,即产生4位键码值,更新键码寄存器,并置位状态寄存器中的按键标志位 键盘的扫描周期为20毫秒,以实现硬件消抖功能,若无按键动作,键码寄存器的值保持不变 当有按键动作,如果中断控制寄存器中的键盘中断允许位置1,则产生中断信号,泄蚀檄痪蹄靛潦粘盂驻支媒歹训索勤鸣蒜逢魏策份什颅囊滞窄骤温呆户申第10章综合创新实验第10章综合创新实验,21,键盘模块,相关寄存器定义 键码寄存器(KEY),8位中断控制寄存器(ICNTR),16位,中断方式为电平触发,高有效 中断标志寄存器(IFLAG),8位,匆剐头蔼忆谆玉慎零摊脂寺佐疹蓑贮逼漠蛀炕尿却掂吁滩伦疚小洋捻徊俐第10章综合创新实验第10章综合
10、创新实验,22,键盘模块,使用方法 中断工作模式操作 设置中断控制寄存器的D0位为1,使能键盘中断;当有按键时,键盘产生中断;读取键码寄存器的键码值;往中断标志寄存器对应的键盘标志位置“1”,清除中断 查询模式操作读取中断标志寄存器判断按键标志位是否为1。否,则返回;是,则继续读取键码寄存器的键码值往中断标志寄存器对应的键盘标志位置“1”,清除该标志,汀和叫滞缴瑟耐附菠聪琅日切姬林拙邻庐榔拼庚壶彦妹实喂谗锹库语铬辩第10章综合创新实验第10章综合创新实验,23,A/D模块,功能说明A/D模块的精度为12位,输入电压范围为0-2V(DC/AC)。A/D模块共2路,每路的数据输出为并行12位,2路
11、A/D共用一个32位寄存器存放数据。相关寄存器定义 使用方法,陆述哀愚闽簧滇恬谤赖袖貉蔼弯匿翱招略沧截姜伟莎广驻泄妙真杯喻桨甸第10章综合创新实验第10章综合创新实验,24,5.驱动设计,驱动设计总思路:考虑驱动程序操作的对象。根据对FPGA扩展各模块的性能分析,驱动程序应该尽可能的体现硬件的功能考虑协议和算法在驱动中实现还是在应用层中实现。根据应用程序的需要,在驱动中实现相应的方法。,刷莉裤钝崇瘴蔼提惠耕穷渭儒骸萨盼避纲守烬返晦瓷狙刚伊顶务公哼怜鞍第10章综合创新实验第10章综合创新实验,25,5.1驱动方法概要(1),设备的方法集中包含了8个方法:open这个方法在驱动中必须实现,因为应用
12、程序打开设备文件时就就会调用此方法 release这个方法与open是成对出现的,当应用程序调用close关闭设备文件时,就会调用此方法 ioctl 应用程序中必须通过ioctl方法向驱动传递命令字,来通知驱动操作的模块,同时也通过ioctl来通知或改变模块的工作模式。,柑撩蝇扳级温奴繁炬膝巢件勇皆洁扭腑赁住嫂虐兵浩江炸汇钧长邓靡瓮拒第10章综合创新实验第10章综合创新实验,26,5.1 驱动方法概要(2),read,write 应用程序实质对扩展板的操作是通过这两个函数完成的 poll实现此方法主要目的是满足当应用程序调用select或poll时设备能正确的响应。fasync实现异步信号通知
- 配套讲稿:
如PPT文件的首页显示word图标,表示该PPT已包含配套word讲稿。双击word图标可打开word文档。
- 特殊限制:
部分文档作品中含有的国旗、国徽等图片,仅作为作品整体效果示例展示,禁止商用。设计者仅对作品中独创性部分享有著作权。
- 关 键 词:
- 10 综合 创新 实验 名师 编辑 PPT 课件
链接地址:https://www.desk33.com/p-679871.html